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对于基于FPGA+DSP架构实现的、需要同时接收处理多系统多频点导航卫星信号的GNSS接收机,随着跟踪通道数目成倍增长以及为提升抗多径等性能造成的每通道相关器数目的增加,FPGA 和DSP之间需要交互的相关值数据量也将成倍增加.
文章提出了一种用于提高GNSS接收机基带处理电路捕获和跟踪效率的设计方法,采用优化的混合串并行时分复用、延迟锁定环(DLL)和锁相环(PLL)等设计方法,从而减小基带处理电路的硬件规模,降低消耗,使GNSS 接收机实现提高捕获速度和定位精度...
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